Zbigniew S. Szewczak Podstawy Systemów Operacyjnych
Transkrypt
Zbigniew S. Szewczak Podstawy Systemów Operacyjnych
Zbigniew S. Szewczak Podstawy Systemów Operacyjnych Wykład 3 Struktura systemu komputerowego Toruń, 2004 System komputerowy ☛Struktura komputera ☛Magistrala systemowa ☛Funkcje jednostki centralnej ☛Struktura wejścia/wyjścia ☛Struktura pamięci System komputerowy ☛Sprzęt (ang. hardware) - zasoby o specyficznej architekturze oraz organizacji zarządzane przez system operacyjny ☛System operacyjny - program, który nadzoruje i koordynuje dostęp programów do zasobów ☛Programy użytkowe - realizują potrzeby użytkowników systemu komputerowego (kompilatory, bazy danych, gry,....) ☛Użytkownicy - ludzie, maszyny, komputery.. Sprzęt komputerowy (c.d.) dyski drukarki jednostka centralna sterownik dysków sterownik drukarek taśma sterownik taśmy szyna systemowa sterownik pamięci pamięć operacyjna Struktura komputera Peryferia Komputer Jednostka centralna (CPU) Komputer Pamięć główna Magistrala systemowa WejścieWyjście Linie komunikacyjne Struktura komputera Peryferia Komputer Jednostka centralna (CPU) Komputer Pamięć główna Magistrala systemowa WejścieWyjście Linie komunikacyjne Magistrala systemowa ☛System bus (ang.) ☛Droga zapewniająca komunikację między (modułami): procesorem, pamięcią i wejściemwyjściem ☛Tryb rozgłaszania (ang. broadcast) ☛50 do 100 oddzielnych linii pogrupowanych w 8, 16, 32 linii zwanych szynami ☛linie danych - do przenoszenia danych ☛np. szyna danych 8b a rozkaz 16b: 2 x transfer z pamięci ☛linie adresowe - do określenia adresu danych ☛linie sterowania - do sterowania liniami ☛linie zasilania Schemat magistrali CPU pamięć ... pamięć sterowanie magistrala adres dane wejściewyjście ... wejściewyjście Linie sterowania ☛Kontrola dostępu i wykorzystanie danych i adresów ☛zapis danych z magistrali pod określonym adresem w pamięci ☛odczyt danych spod określonego adresu pamięci ☛zapis do portu we/wy ☛odczyt z portu we/wy ☛potwierdzenie przesłania (ang. transfer ACK) ☛zapotrzebowanie na magistralę (ang. bus request) ☛rezygnacja z magistrali (ang. bus grant) ☛żądanie przerwania (ang. interrupt request) - zawieszenie ☛potwierdzenie przerwania (ang. interrupt ACK) - rozpoznanie ☛zegar - synchronizowanie opercji ☛reset - ustawienie modułów w stanie początkowym Linie sterowania - działanie ☛Moduły chcą przesłać dane między sobą: ☛uzyskanie dostępu do magistrali ☛przekazanie danych za pośrednictwem magistrali ☛Moduł chce uzyskać dane z innego modułu: ☛uzyskanie dostępu do magistrali ☛przekazanie zapotrzebowania przez linie sterowania i adresowe ☛czekanie na dane ☛ Stuktury wielomagistralowe ☛Duża ilość modułów opóźnia działanie magistrali ☛można zwiększać szybkość magistrali lub jej szerokość (z 32b na 64b) ☛jednak szybkość modułów (grafika, video) wzrasta bardziej ☛Struktury wielomagistralowe o określonej hierarchii ☛lokalna magistrala: procesor <->pamięć podręczna ☛magistrala systemowa: we/wy komunikując się z pamięcią główną poprzez interfejs szyny rozszerzenia (ang. expansion bus) nie ma wpływu na działanie procesora ☛szyna rozszerzenia buforuje dane między magistralą systemową a sterownikami we/wy dołączonymi do szyny rozszerzenia (ang. expansion bus) ☛ Tradycyjna magistrala systemowa (ISA) procesor Pamięć główna magistrala lokalna Pamięć podręczna Lokalny sterownik we/wy magistrala systemowa Interfejs szyny rozszerzenia Sieć SCSI szyna rozszerzenia Drukarka Modem Magistrala o dużej wydajności Pamięć główna magistrala Procesor lokalna SCSI Cache/ Bridge FireWire magistrala systemowa Grafika Wideo LAN szyna szybkiego przesyłania FAX Konsola Interfejs szyny rozszerzenia szyna rozszerzenia Modem Drukarka Przykład Pentium ☛cache(L2), local bus, memory bus ☛PCI bridge chip: local, memory, szyna PCI ☛ISA (ang. Industry Standard Architecture) ☛I/O bus: EIDE (ang. Enhance Integrated Drive Electronics), ATA (ang. Advanced Technology Attachment) - dyski 16,67MBps ☛PCI (ang. Peripheral Component Interconnect) ☛SCSI (ang. Small Computer System Interface) ☛szybkie we/wy do 160MBps (dyski,..) ☛USB (ang. Universal Serial Bus) ☛wolne urządzenia we/wy do 1.5MBps, (mysz, skaner,..) ☛IEEE 1394 (FireWire) - do 50MBps (multimedia) ☛sygnalizacja równoległa Struktura magistralowa Pentium L2 cache magistrala podręczna magistrala CPU lokalna most PCI magistrala pamięć pamięci magistrala pci złącza PCI SCSI USB mysz most ISA dysk IDE adapter grafiki klawiatura magistrala isa złącza ISA modem karta dźwiękowa drukarka monitor Płyta główna PCI-X - architektura CPU processor system bus AGP grafika memory bridge pamięć (northbridge) HubLink HDD ATA USB 1.1 I/O bridge (southbridge) Chipset PCI lokalne we/wy PCI Express - 3GIO ☛multimedialne systemy systemy operacyjne ☛video-on-demand, redystrybucja audio (GbEthernet) ☛PCI Express: szyna III generacji ≈ 2xPCI ☛kompatybilna z PCI, zastępuje szynę AGP(ang. Accelerated Graphics Port, 4xPCI) ☛komunikacja szeregowa ☛technologia szyny lokalnej (nie dla szyny pamięci) ☛www.intel.com/technology/pciexpress/devnet/ ☛CHIP 8/2003 ☛technologia transmisji chip-to-chip - 6.5 GBps ☛www.hypertransport.org/technology.html PCI Express - architektura CPU grafika Serial ATA HDD memory bridge pamięć 3GIO USB 2.0 I/O bridge lokalne we/wy Gb Ethernet mobile docking switch PCI Struktura komputera Peryferia Komputer Jednostka centralna (CPU) Komputer Pamięć główna Magistrala systemowa WejścieWyjście Linie komunikacyjne Funkcje jednostki centralnej ☛CPU = procesor = jednostka centralna ☛Pobieranie rozkazów z pamięci ☛Interpretowanie rozkazów ☛Pobieranie danych (z pamięci lub we/wy) ☛Przechowywanie danych w pamięci ☛Przetwarzanie danych - wykonywanie rozkazów ☛Zapisywanie wyników (do pamięci lub na we/wy) Schemat jednostki centralnej CPU Komputer We/Wy System Bus Pamięć CPU Rejestry Jednostka arytmetycznologiczna (ALU) Połączenia wewnętrzne CPU Jednostka sterująca Rejestry procesora ☛licznik programu (PC) - adres rozkazu do pobrania ☛rejestr rozkazu (IR) - kod rozkazu ☛rejestr adresowy pamięci (MAR) - adres lokacji ☛rejestr buforowy pamięci (MBR) - dane do/z pamięci ☛rejestry PSW (ang. program status word) słowo stanu programu, informacje o stanie PSW (bity, flagi) ☛znak - bit znaku ostatniej operacji ☛zero - wynik operacji = zero ☛przeniesienie (ang. carry) - przeniesienie w wielokrotnej precyzji ☛równość (ang. equal) - wynik porównania logicznego ☛przepełnienie - (ang. overflow) ☛zezwolenie/blokowanie przerwań ☛nadzorca - tryb systemu lub tryb użytkownika Struktura - Jednostka sterująca Jednostka sterująca CPU ALU CPU Jednostka Internal sterująca Bus Rejestry Rejestry i dekodery Układy logiczne szeregowania Wewnętrzna szyna danych Synchronizacja i sterowanie Technologia mobilna - Centrino ☛Komputery przenośne (laptopy) ☛Wireless LAN (do 11Mbps) ☛Procesor Intel Pentium M ☛modyfikacja Pentium Pro (energooszczędna 0.9GHz-1.6GHz) ☛szyna systemowa 400MHz; L1 cache - 64kB; L2 cache - 1MB; ☛Intel Chipset 855 ☛grafika 3D; USB 2.0; do 2GB pamięci DDR SDRAM ☛Intel PRO/Wireless 2100 ☛standard 802.11b ☛zarządzanie zasilaniem ☛http://www.intel.com/products/mobiletechnology/centrino Struktura komputera Peryferia Komputer Jednostka centralna (CPU) Komputer Pamięć główna Magistrala systemowa WejścieWyjście Linie komunikacyjne Wejście/Wyjście ☛Dlaczego nie łączy się urządzeń peryferyjnych bezpośrednio z magistralą systemową? ☛wielka różnorodność urządzeń we/wy ☛przesyłanie różnej ilości danych ☛z różną prędkością ☛w różnym formacie ☛urządzenia we/wy za wolne dla procesora i pamięci ☛Potrzeba modułu we/wy ☛interfejs z procesorem i pamięcia przez magistralę ☛interfejs z urządzeniami peryferyjnymi Model modułu we/wy linie adresowe magistrala linie danych linie sterowania Moduł wejścia/wyjścia urządzenie we/wy urządzenie we/wy urządzenie we/wy Kategorie wejścia/wyjścia ☛Rodzaje urządzeń we/wy ☛przeznaczone do odczytu przez człowieka (np. monitor ekranowy, wydruk, dźwięk) ☛przeznaczone do odczytu przez maszynę (np. dyski magnetyczne, taśmy, czujniki w robotach ) ☛komunikacyjne (np. modem, karta sieciowa) Funkcje modułu we/wy ☛Sterowanie i taktowanie (zegar) ☛Komunikacja z procesorem ☛Komunikacja z urządzeniem ☛Buforowanie danych ☛Wykrywanie błędów Funkcje modułu we/wy (c.d.) ☛Sterowanie i taktowanie (zegar), np.: ☛procesor żąda statusu urządzenia we/wy ☛moduł we/wy udziela odpowiedzi ☛jeśli urządzenie jest gotowe procesor wydaje rozkaz ☛moduł we/wy otrzymuje dane z urządzenia ☛dane są przenoszone z modułu we/wy do procesora ☛Komunikacja z procesorem ☛dekodowanie rozkazu przez moduł we/wy ☛przesyłanie danych poprzez magistralę ☛przesyłanie informacji o stanie modułu we/wy ☛rozpoznawanie adresu modułu we/wy Funkcje modułu we/wy ☛Komunikacja z urządzeniem ☛sygnały sterujące z modułu we/wy (np. ustaw głowicę dysku) ☛sygnały stanu do modułu we/wy (np. ready, not-ready) ☛dane do/z modułu we/wy ☛dane specyficzne dla urządzenia do/z otoczenia ☛Buforowanie danych ☛dane są buforowane w module we/wy i wysyłane do urządzenia z prędkością stosowaną dla tego urządzenia ☛Wykrywanie błędów, np.: ☛7-bitowy kod ASCII, ósmy bit ustawiany w zależności od tego czy jest parzysta liczba jedynek czy nie Prędkości urządzeń we/wy ☛klawiatura - 10 bps ☛mysz - 100 bps ☛modem (56 kbps) - 7 kBps ☛kanał telefoniczny - 8 kBps ☛ISDN (dual) - 16 kBps ☛drukarka laserowa - 100 kBps ☛skaner - 400 kBps ☛Ethernet klasyczny - 1.25 MBps ☛USB - 1.5 MBps ☛dysk IDE - 5 MBps ☛40x CD-ROM - 6 MBps Prędkości urządzeń we/wy (c.d) ☛Fast Ethernet - 12.5 MBps ☛szyna ISA - 16.7 MBps ☛dysk EIDE (ATA-2) - 16.7 MBps ☛FireWire (IEE1394) - 50 MBps ☛monitor XGA - 60 MBps ☛łącze SONET OC-12 - 78 MBps ☛dysk SCSI Ultra-2 - 80 MBps ☛Ethernet gigabitowy - 125 MBps ☛klasyczna szyna PCI - 133 MBps (32b na 33MHz) ☛szyna PCI 2.1 - 533 MBps (64b na 66MHz) ☛Sun Gigaplane XB backplane - 20 GBps Struktura modułu we/wy interfejs z magistralą systemową interfejs z urządzeniem zewnętrznym rejestry danych Uklady logiczne interfejsu z urządzeniem zewnętrznym linie danych rejestry stanu/sterowania linie adresowe linie sterowania Uklady logiczne wejścia/wyjścia . . . . . . Uklady logiczne interfejsu z urządzeniem zewnętrznym dane status sterowanie dane status sterowanie Rodzaje modułów we/wy ☛Sterownik wejścia/wyjścia (urządzenia) prymitywny, wymaga szczegółowego sterowania ☛mikrokomputery, minikomputery ☛Kanał (procesor) wejścia/wyjścia - przejmuje większość obciążenia we/wy CPU, wysoki priorytet dojścia do procesora ☛superkomputery, duże instalacje Sposoby realizacji we/wy ☛programowane - dane są wymieniane między procesorem a modułem we/wy, procesor czeka na zakończenie operacji we/wy ☛sterowane przerwaniami - procesor wydaje operację we/wy i wykonuje dalsze rozkazy do momentu zakończenia operacji we/wy (przerwanie we/wy) ☛bezpośredni dostęp do pamięci (ang. direct memory access - DMA) - moduł we/wy wymienia dane bezpośrednio z pamięcią bez udziału procesora We/wy progamowane błąd CPU -> we/wy wydaj modułowi we/wy rozkaz odczytu we/wy -> CPU odczytaj stan modułu we/wy sprawdź stan we/wy -> CPU CPU -> pamięć odczytaj słowo w module we/wy zapisz słowo w pamięci wykonane? nie gotowy nie tak następna instrukcja We/wy sterowane przerwaniami wykonaj coś innego przerwanie błąd CPU -> we/wy wydaj modułowi we/wy rozkaz odczytu we/wy -> CPU odczytaj stan modułu we/wy sprawdź stan we/wy -> CPU CPU -> pamięć odczytaj słowo w module we/wy zapisz słowo w pamięci wykonane? nie gotowy nie tak następna instrukcja Bezpośredni dostęp do pamięci wydaj modulowi DMA rozkaz odczytania bloku odczytaj stan modułu DMA następna instrukcja CPU -> DMA wykonaj coś innego przerwanie DMA -> CPU Struktura komputera Peryferia Komputer Jednostka centralna (CPU) Komputer Pamięć główna Magistrala systemowa WejścieWyjście Linie komunikacyjne Pamięć i jej własności ☛Lokalizacja ☛Pojemność ☛Jednostka transferu ☛Metoda dostępu ☛Wydajność ☛Rodzaj fizyczny ☛Własności fizyczne ☛Organizacja Pamięć - lokalizacja, miara ☛CPU ☛wewnętrzna (główna) ☛zewnętrzna (pomocnicza) ☛długość słowa - 8, 16, 32 bitów (b) ☛pojemność pamięci mierzona w ilości słów ☛lub w Bajtach Pamięć - jednostka transferu ☛pamięć wewnętrzna ☛zwykle szerokość szyny danych ☛pamięć zewnętrzna ☛zwykle bloki o wiele większe niż słowo ☛jednostka adresowalna ☛najmniejsza ilość danych dająca się jednoznacznie zaadresować (zwykle słowo ale może być to klaster na dysku) ☛N = ilość adresowalnych jednostek; A = długość adresu ☛ zależność: N = 2^A Pamięć - metody dostępu (1) ☛dostęp sekwencyjny (ang. sequential) ☛dostęp liniowy blok po bloku wprzód lub wtył ☛czas dostępu zależy od pozycji bloku względem pozycji bieżącej ☛np. taśmy ☛dostęp bezpośredni (ang. direct) ☛każdy blok ma unikalny adres ☛czas dostępu realizowany przez skok do najbliższego otoczenia i sekwencyjne przeszukiwanie ☛np. dysk magnetyczny Prędkość kątowa a liniowa ☛Dyski magnetyczne obracją się ze stałą prędkością kątową (ang. constant angular velocity) ☛adresowanie bloków za pomocą cylindra, ścieżki i sektora ☛wymagany jest tylko mały ruch głowicy przy zmianie ścieżki oraz oczekiwanie na sektor ☛sporo pustego miejsca miejsca na zewnętrznych ścieżkach ☛Płyty CD obracją się ze stałą prędkością liniową (ang. constant linear velocity) ☛informacje na ścieżkach w segmentach o jednakowej długości ☛dysk obraca się najwolniej na zewnętrznych scieżkach ☛ Pamięć - metody dostępu (2) ☛dostęp swobodny (ang. random) ☛każda adresowalna lokacja w pamięci ma unikatowy, fizycznie wbudowany mechanizm adresowania ☛czas dostępu nie zależy od poprzednich operacji i jest stały ☛np. RAM ☛ dostęp skojarzeniowy (ang. associative) ☛dane są lokalizowane raczej na podstawie porównania z ich zawartością niż na podstawie adresu ☛czas dostępu nie zależy od poprzednich operacji i jest stały ☛np. pamięć podręczna (ang. cache) Pamięć - wydajność (definicje) ☛ czas dostępu ☛dostęp swobodny : czas niezbędny do zrealizowania operacji ☛dostęp nieswobodny : czas potrzebny na ustawienie głowicy ☛ czas_cyklu pamięci ☛ czas dostępu + czas, który musi upłynąć aby mógła nastąpić kolejna operacja ( zapis, odczyt) ☛ szybkość transferu ☛ dostęp swobodny : 1/czas_cyklu ☛ dostęp nieswobodny : T_n = T_a + n/r ☛ T_n - śr. czas operacji na n-bitach;T_a = śr. czas dostępu ☛ r - szybkość transferu w b/sek Pamięć - rodzaje fizyczne ☛półprzewodnikowa (ang. semiconductor) ☛RAM ☛magnetyczna ☛dysk & taśma ☛magneto-optyczna ☛CD & DVD Pamięć - własności fizyczne ☛zanikanie, rozpad (ang. decay) ☛ulotność (ang. volatility ) ☛wymazywalność (ang. erasable) ☛zasilanie do utrzymania zawartości Pamięć - organizacja ☛Naturalny porządek bitów w słowie ☛Nie zawsze oczywisty Fundamentalne pytania ☛podstawowe pytania projektowania pamięci komputerów ☛Ile ? ☛wszystkiego (otwarte) ☛większa pojemność to mniejszy koszt na bit ☛Jak szybko ? ☛większa pojemność to większy czas dostępu ☛Za ile ? ☛mniejszy czas dostępu to większy koszt na bit ☛kompromis: hierarchia pamięci Hierarchia pamięci ☛Jak osiągnąć efektywność ze względu na koszt? ☛rejestry ☛w CPU ☛pamięć wewnętrzna lub główna ☛ pamięć podręczna (cache) - może być wiele poziomów ☛ pamięć główna - “RAM” ☛pamięć zewnetrzna ☛ dyskowa pamięć podręczna ☛ pamięć dyskowa ☛ pamięć taśmowa lub dysk optyczny Hierarchia pamięci (c.d.) ☛od góry do dołu: ☛malejący koszt na bit ☛rosnąca pojemność ☛rosnący czas dostępu ☛malejąca częstotliwość dostępu do pamięci przez procesor Zasada lokalności odniesień ☛zasada lokalności odniesień (ang. locality of reference) oznacza, że w czasie wykonania programu odwołania do danych i rozkazów mają tendencję do gromadzenia się ☛przyczyna: programy zwykle zawierają tablice deklaracji zmiennych oraz stałych i wiele pętli iteracyjnych i podprogramów ☛wykorzystanie zasady lokalności odniesień pozwala na zmniejszenie częstotliwości dostępu ☛przykład: pamięć podręczna procesora Pamięć podręczna a główna ☛prędkość procesora a prędkość pamięci ☛mała szybka pamięć (droga) ☛wykorzystanie zasady lokalności odniesień CPU w bajtach Cache w blokach Pamięć Pamięć podręczna - działanie ☛cache zawiera fragment pamięci głównej ☛procesor sprawdza czy aktualnie potrzebne do wykonania rozkazu słowo z pamięci jest w cache’u ☛jeśli nie, to blok pamięci o ustalonej liczbie K słów zawierający potrzebne słowo jest ściągnięty do pamięci podręcznej Pamięć podręczna (c.d.) ☛rozmiar cache’u ☛mały cache poprawia wydajność ☛rozmiar bloku ☛większy blok: większe prawdopodobieństwo, że słowo jest w cache’u (zasada lokalności) ☛zbyt duży blok: większe prawdopodobieństwo, że słowo jest w usuniętym bloku ☛funkcja mapująca (ang. mapping function) ☛określa lokalizację bloku w cachu’u ☛przykład: 6b adres, 2b tag(znacznik) 01: 010000, 010001, 010010, 010011, 010100, 010101, 010110, 010111, 011000, 011001, 011010, 011011, 011100, 011101, 011110, 011111 Struktura pamięci podręcznej i głównej tag 0 1 2 blok 0 1 2 3 . . . C-1 blok (K słów) . . . długość bloku (K słów) cache blok 2^n-1 CPU pamięć długość słowa Pamięć podręczna (c.d.) ☛Algorytm zastępowania ☛określa, który blok należy zastąpić ☛last-recently-used (LRU) - zastąp najdawniej użyty ☛Polityka zapisywania (ang. write policy) ☛określa, kiedy zmieniony blok cache’u jest zapisywany do pamięci głównej ☛za każdym razem kiedy jest zmieniony ☛tylko wtedy, gdy jest zastępowany: minimalizuje ilość operacji zapisywania ale pamięć główna może być nieaktualna (np. w połączeniu z DMA) ☛ Pamięć podręczna - przykłady ☛80386 - brak ☛80486 - 8kB cache ☛Pentium - dwa cache: 8kB dla danych i 8kB dla rozkazów ☛Pentium II ☛8kB (rozkazy) i 8kB-16kB (dane) - L1 cache (CPU chip) ☛256kB->1MB - L2 cache ☛ Pamięć półprzewodnikowa ☛RAM (ang. Random Access Memory) ☛nazwa myląca bowiem wszystkie pamięci półprzewodnikowe mają dostęp swobodny ☛odczyt/zapis ☛ulotna ☛sposób wymazywania: elektryczny ☛statyczna (ang. static) lub dynamiczna (ang. dynamic) ☛DIMM (ang. dual in-line memory module) rodzaj pamięci RAM dla PC Pamięć dynamiczna (DRAM) ☛bity zapamiętane jak ładunki w kondensatorach ☛rozładowywanie ☛okresowe “odświeżanie ładunku” ☛prosta budowa ☛mała ☛tania ☛wolna ☛asynchroniczna ☛zastosowanie: pamięć główna Przykład działania DRAM ☛16 Mb DRAM - 4 bity czytane i pisane jednocześnie ☛tablica: 2048 wierszy i 2048 kolumn ☛linie adresowe A0-A10 (2^11=2048) ☛11 sygnałów określa połowę adresu wiersza lub kolumny ☛sygnał wyboru wiersza RAS (ang. row address select) ☛sygnał wyboru kolumny CAS (ang. column address select) ☛DRAM zablokowany podczas odświeżania ☛MUX pozwala na 4-krotne zwiększenie pamięci Pamięć DRAM 16Mb (4Mx4) RAS CAS WE OE taktowanie i sterowanie licznik odświeżania MUX dekoder wiersza A0 A1 A10 bufor adresu wiersza . . . bufor adresu kolumny . . . Tablica pamięci (2048x2048x4) . . . wzmacniacz odczytu i bramka we/wy dekoder kolumny wejściowy bufor danych wyjściowy bufor danych D1 D2 D3 D4 Inne pamięci DRAM ☛EDRAM (ang. Enhanced DRAM)- wzbogacona o pamięć podręczną statyczną RAM (16b) ☛CDRAM (ang. Cache DRAM)- zawiera pamięć podręczną o 2Kb statycznej RAM ☛SDRAM (ang. Synchronous DRAM) - pamięć synchroniczna, transmisja do/z CPU pod kontrolą zewnętrznego zegara systemowego; bardzo wydajna przy dużych transferach (np. multimedia) ☛DDR (ang. double-data-rate ) SDRAM - ok. 3GBps ☛RDRAM (ang. Rambus DRAM) - do 3.5GBps Pamięć statyczna (SRAM) ☛bity przechowywane za pomocą przerzutników ☛nie wymaga odświeżania ☛bardziej złożona budowa ☛większa ☛droższa ☛szybsza ☛zastosowanie: pamięć podręczna ☛przykład: CMOS (ang. complementary metaloxide-semiconductor) - zasilanie: bateria Pamięć stała (ROM) ☛ROM - ang. read-only memory ☛trwały wzór danych ☛zastosowanie: ☛ mikroprogramowanie ☛ tablice funkcji ☛ programy systemowe (BIOS, ang. Basic Input Output System - niskopoziomowe we/wy) ☛ podprogramy biblioteczne dla często wywoływanych funkcji Rodzaje pamięci ROM (1) ☛zapisywana w trakcie produkcji ☛bardzo droga dla małych serii ☛pamięć programowalna (PROM, ang. programmable) ☛do zapisu (tylko raz) wymagane jest specjalne urządzenie ☛pamięć głównie do odczytu (ang. read-mostly memory) ☛optycznie wymazywalna programowalna pamięć stała (ang. Erasable Programmable (EPROM)) ☛wymazywananie : naświetlanie promieniowaniem ultrafioletowym z układu znajdującego się w obudowie Rodzaje pamięci ROM (2) ☛pamięć głównie do odczytu (c.d.) ☛elektrycznie wymazywalna programowalna pamięć stała (ang. Electrically Erasable Programmable (EEPROM)) ☛zapisywane są tylko bajty zaadresowane ☛zapisywanie trwa dłużej niż odczyt (kilka mikrosekund/B) ☛mniej gęsto upakowana niż EPROM ☛pamięć błyskawiczna (ang. Flash memory, Flash EEPROM) ☛wymazywanie elektryczne ☛nie umożliwia wymazywania na poziomie bajtu ☛szybsza niż EPROM ☛tańsza niż EEPROM ☛zastosowanie: BIOS, Cisco IOS, PenDrive= USB flash memory drive (do 2GB) Przykład - router Cisco System IOS Konfiguracja booting FLASH CPU NVRAM ROM interfejs szyny RAM magistrala interfejs we/wy interfejs we/wy interfejs we/wy CPU CPU CPU IOS tablice routingu Literatura ☛W. Stallings - Architektura i organizacja systemu komputerowego, WNT, 2000 ☛ http://William.Stallings.com/COA5e.html Strony WWW ☛www.pcguide.com ☛www.top500.org ☛WWW Computer Architecture Home Page ☛CPU Info Center ☛ACM Special Interest Group on Computer Architecture ☛IEEE Technical Committee on Computer Architecture ☛Intel Technology Journal ☛Strony domowe producentów komputerów ☛Intel, IBM, etc. Grupy dyskusyjne (Usenet) ☛comp.arch ☛comp.arch.arithmetic ☛comp.arch.storage Podsumowanie (1) ☛struktura komputera: ☛CPU wykonuje rozkazy ☛pamięć przechowuje rozkazy i dane ☛zewnętrzna lub wewnętrzna ☛we/wy przesyła dane do/z pamięci ☛magistrala zapewnia komunikację tego wszystkiego ☛przykład Pentium ☛we/wy - realizowane przez moduły we/wy ☛programowo, sterowane przerwaniami, bezpośrednio (DMA) Podsumowanie (2) ☛dostęp do pamięci ☛sekwencyjny, bezpośredni, swobodny, skojarzeniowy ☛pamięć półprzewodnikowa ☛ulotna: RAM ☛dynamiczna lub statyczna ☛stała : ROM ☛PROM, EPROM, Flash Co dalej? - działanie komputera Peryferia Komputer Jednostka centralna (CPU) Komputer Pamięć główna Magistrala systemowa WejścieWyjście Linie komunikacyjne Następny wykład ☛działanie komputera ☛rozkazy ☛cykl pobrania, wykonania i przerwania ☛ochrona sprzętowa ☛dualny tryb operacji: monitora i użytkownika ☛uprzywilejowane rozkazy we/wy ☛rejestr bazowy i graniczny ☛machanizm przerwań zegarowych ☛wywołania systemowe w procesie użytkownika